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通用芯?;ミB技術(shù)(Universal Chiplet Interconnect Express)是Chiplet標(biāo)準(zhǔn)聯(lián)盟提出的芯粒高速互聯(lián)標(biāo)準(zhǔn)。通用芯?;ミB技術(shù)一個(gè)開放的芯粒互連協(xié)議,旨在芯片封裝層面確立互聯(lián)互通的統(tǒng)一標(biāo)準(zhǔn),滿足客戶對(duì)可定制封裝要求。通用芯?;ミB技術(shù)提供了物理層和die-to-die適配器。物理層包含裸片間通信的電氣信號(hào)、時(shí)鐘標(biāo)準(zhǔn)、物理通道數(shù)量等規(guī)范,可以包含來自多家不同公司當(dāng)前所有類型的封裝選項(xiàng),包括標(biāo)準(zhǔn)2D封裝和更先進(jìn)的2.5D封裝。隨著3D芯片封裝的推出,UCIe標(biāo)準(zhǔn)還需不斷升級(jí),未來也將最終擴(kuò)展到3D封裝互連。

通用芯?;ミB技術(shù)(Universal Chiplet Interconnect Express)是Chiplet標(biāo)準(zhǔn)聯(lián)盟提出的芯粒高速互聯(lián)標(biāo)準(zhǔn)。通用芯?;ミB技術(shù)一個(gè)開放的芯?;ミB協(xié)議,旨在芯片封裝層面確立互聯(lián)互通的統(tǒng)一標(biāo)準(zhǔn),滿足客戶對(duì)可定制封裝要求。通用芯粒互連技術(shù)提供了物理層和die-to-die適配器。物理層包含裸片間通信的電氣信號(hào)、時(shí)鐘標(biāo)準(zhǔn)、物理通道數(shù)量等規(guī)范,可以包含來自多家不同公司當(dāng)前所有類型的封裝選項(xiàng),包括標(biāo)準(zhǔn)2D封裝和更先進(jìn)的2.5D封裝。隨著3D芯片封裝的推出,UCIe標(biāo)準(zhǔn)還需不斷升級(jí),未來也將最終擴(kuò)展到3D封裝互連。收起

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    Chiplet是一種利用先進(jìn)封裝方法將不同工藝/功能的芯片進(jìn)行異構(gòu)集成的技術(shù),讓SoC的功能能夠以不同的工藝節(jié)點(diǎn)去實(shí)現(xiàn)。不過,最初Chiplet產(chǎn)業(yè)發(fā)展比較混亂,各家大廠主導(dǎo)的功能Die(裸片)無(wú)法互連互通,UCIe(Universal chiplet interconnect express)標(biāo)準(zhǔn)應(yīng)運(yùn)而生,并迅速得到行業(yè)認(rèn)可。隨著SoC復(fù)雜度攀升,產(chǎn)業(yè)界對(duì)UCIe的性能要求也越來越高。
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    近幾年Chiplet的概念很火,海內(nèi)外頭部廠商紛紛入局,包括AMD、英特爾、英偉達(dá)、蘋果、華為、寒武紀(jì)、芯原股份、芯動(dòng)科技、壁仞科技、龍芯、北極雄芯等。 那些最會(huì)做大芯片的廠商都在入局Chiplet 作為Chiplet領(lǐng)域第一個(gè)吃螃蟹的“人”,2017年AMD推出第一代EPYC(霄龍)服務(wù)器CPU,采用了同構(gòu)Chiplet的方式實(shí)現(xiàn)了多個(gè)Die的互聯(lián),降低了整體成本并提高了良率;2019年AMD推
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    2023/04/06
  • 中國(guó)Chiplet的機(jī)遇與挑戰(zhàn)及芯片接口IP市場(chǎng)展望 摩爾定律失效 芯片性能提升遇瓶頸
    在探討Chiplet(小芯片)之前,摩爾定律是繞不開的話題。戈登·摩爾先生在1965 年提出了摩爾定律:每年單位面積內(nèi)的晶體管數(shù)量會(huì)增加一倍,性能也會(huì)提升一倍。這意味著,在相同價(jià)格的基礎(chǔ)上,能獲得的晶體管數(shù)量翻倍。不過,摩爾先生在十年后的1975年,把定律的周期修正為24個(gè)月。至此,摩爾定律已經(jīng)影響半導(dǎo)體行業(yè)有半個(gè)世紀(jì)。 隨著集成電路技術(shù)的不斷演進(jìn),半導(dǎo)體行業(yè)發(fā)現(xiàn)摩爾定律在逐漸失效。上圖右上部分是
  • 為什么UCIe最適合多晶片系統(tǒng) ?
    《道德經(jīng)》里說“圖難于其易,為大于其細(xì)。天下難事,必作于易;天下大事必作于細(xì)。”其實(shí)芯片也是這樣,要做大,先做小,這里的從小做起不僅是指器件建模、RTL描述或IP實(shí)現(xiàn),還包括以真正的“芯粒”組合來搭建大芯片。
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    2023/01/16