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[摘要] 作者：Massimo Inzaghi, 資深應(yīng)用工程師，Mentor Graphcis公司如果您還沒有注意到現(xiàn)在是SoC時(shí)代（雖然并非總是如此），不妨回想一下個(gè)人計(jì)算時(shí)代，許多實(shí)例都證明這個(gè)時(shí)代已快速衰落，成為歷史。曾幾何

由于具備大規(guī)模生產(chǎn)能力、低成本工具和越來越低的掩膜價(jià)格，當(dāng)前的專用 ASIC 設(shè)計(jì)極具成本優(yōu)勢(shì)

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[摘要] 如今已沒有必要購買價(jià)格昂貴的用于高級(jí)納米SoC設(shè)計(jì)的尖端設(shè)計(jì)工具。本白皮書概述了成熟的工藝技術(shù)，適用于物聯(lián)網(wǎng) (IoT) 等應(yīng)用。閱讀本白皮書，了解如何： • 使用IP模塊和模擬電路模塊縮短設(shè)計(jì)時(shí)間并減少設(shè)

針對(duì)全定制模擬和混合信號(hào)設(shè)計(jì)的全流程工具平臺(tái)

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[摘要] 一些EDA工具供應(yīng)商提供了用于 AMS 設(shè)計(jì)的軟件，但這些工具不是成本太高（性價(jià)比低），就是需要大量數(shù)據(jù)操作和手動(dòng)集成的自定義點(diǎn)工具。這個(gè)獨(dú)特的 EDA AMS IC 設(shè)計(jì)流程涵蓋： • 前端設(shè)計(jì) &bul

MEMSIC 攻克加速度計(jì)難題

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[摘要] 加速度計(jì)在很多市場中都有著重要的作用。智能手機(jī)中會(huì)用到加速度計(jì)，汽車中也會(huì)用到加速度計(jì)。測(cè)量速度的變化率似乎可以有無限的應(yīng)用。雖然有很多設(shè)計(jì)技術(shù)可用來創(chuàng)建加速度計(jì)，但 MEMSIC® Inc. 使用Tanner工具開發(fā)了沒有可

Verilog-A 將設(shè)計(jì)精度推向一個(gè)新的水平

資源大?。?.56MB

[摘要] 如果您需要為 TFT、太陽能電池、晶閘管、LDMOS、圖像傳感器或 MEMS 等特殊器件創(chuàng)建自己的模型，Verilog-A 可以為您提供有效描述器件行為的語言。Verilog-A 的優(yōu)點(diǎn)包括： • 以更快的運(yùn)行時(shí)間完成行

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